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HDLによるVLSI設計 : VerilogHDLとVHDLによるCPU設計

深山正幸[ほか]著. -- 共立出版, 1999. <BB00226157>
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HDLによるVLSI設計 : VerilogHDLとVHDLによるCPU設計

深山正幸[ほか]著. -- 共立出版, 1999. <BB00226157>
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所蔵一覧 1件～3件（全3件）

No. 巻号 所蔵館 配置場所 請求記号 資料ID 状態 返却予定日 予約
0001 中央館 研究室-工
 		549.7/HD 0311999085720 通常 0件
0002 中央館 研究室-工
 		549.7/HD 0312000030683 通常 0件
0003 中央館 研究室-工
 		549.7/HD 0312001023078 通常 0件
No. 0001
巻号
所蔵館 中央館
配置場所 研究室-工
請求記号 549.7/HD
資料ID 0311999085720
状態 通常
返却予定日
予約 0件
No. 0002
巻号
所蔵館 中央館
配置場所 研究室-工
請求記号 549.7/HD
資料ID 0312000030683
状態 通常
返却予定日
予約 0件
No. 0003
巻号
所蔵館 中央館
配置場所 研究室-工
請求記号 549.7/HD
資料ID 0312001023078
状態 通常
返却予定日
予約 0件
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書誌詳細

標題および責任表示 HDLによるVLSI設計 : VerilogHDLとVHDLによるCPU設計 / 深山正幸[ほか]著
HDL ニ ヨル VLSI セッケイ : Verilog HDL ト VHDL ニ ヨル CPU セッケイ
出版・頒布事項 東京 : 共立出版 , 1999.6
形態事項 201p ; 24cm
巻号情報
ISBN 4320029348
注記 参考図書: p[197]-198
注記 その他の著者: 北川章夫, 秋田純一, 鈴木政國
学情ID BA42033178
本文言語コード 日本語
著者標目リンク 深山, 正幸(1966-)
フカヤマ, マサユキ
著者標目リンク 北川, 章夫(1961-)
キタガワ, アキオ
著者標目リンク 秋田, 純一(1970-)
アキタ, ジュンイチ
著者標目リンク 鈴木, 政國(1939-)
スズキ, マサクニ
分類標目 電子工学 NDC8:549.7
分類標目 電子工学 NDC9:549.7
件名標目等 集積回路||シュウセキカイロ
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