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Verilog HDLで学ぶコンピュータアーキテクチャ

浅川毅, 四柳浩之, 土屋秀和共著. -- コロナ社, 2024. <BB30356881>
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Verilog HDLで学ぶコンピュータアーキテクチャ

浅川毅, 四柳浩之, 土屋秀和共著. -- コロナ社, 2024. <BB30356881>
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所蔵一覧 1件～1件（全1件）

No. 巻号 所蔵館 配置場所 請求記号 資料ID 状態 返却予定日 予約
0001 中央館 研究室-工
 		548.2/AS 0312023091481 通常 0件
No. 0001
巻号
所蔵館 中央館
配置場所 研究室-工
請求記号 548.2/AS
資料ID 0312023091481
状態 通常
返却予定日
予約 0件
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書誌詳細

標題および責任表示 Verilog HDLで学ぶコンピュータアーキテクチャ / 浅川毅, 四柳浩之, 土屋秀和共著
Verilog HDL デ マナブ コンピュータ アーキテクチャ
出版・頒布事項 東京 : コロナ社 , 2024.2
形態事項 vi, 191p : 挿図 ; 21cm
巻号情報
ISBN 9784339029406
その他の標題 奥付タイトル:Computer architecture with Verilog HDL
注記 引用・参考文献: p[188]
学情ID BD05575752
本文言語コード 日本語
著者標目リンク 浅川, 毅||アサカワ, タケシ <AU10160447>
著者標目リンク 四柳, 浩之
ヨツヤナギ, ヒロユキ <>
著者標目リンク 土屋, 秀和
ツチヤ, ヒデカズ <>
分類標目 情報工学 NDC9:548.2
分類標目 情報工学 NDC10:548.2
件名標目等 コンピュータ||コンピュータ
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